NKTU01-6

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全功率輸入帶寬（FullPowerAnalogInputBandwidth）是指當(dāng)ADC輸出信號(hào)幅度低于最大輸出電平3dB時(shí)的輸入信號(hào)頻率范圍。一般采樣速率越高，全功率輸入帶寬就越寬。對(duì)于ADC而言，被采樣信號(hào)的帶寬必須在全功率輸入帶寬之內(nèi)，否則在模擬輸入帶寬之外的頻率成分因衰減過(guò)多而無(wú)法正確地反映原始信號(hào)。


軟件無(wú)線電中通常采用的ADC和DAC的結(jié)構(gòu)包括以下4種類型：
 
（1）并行結(jié)構(gòu)，包括Flash-ADC和串狀DAC；
 
（2）分段結(jié)構(gòu)，包括折疊內(nèi)插ADC和“分段”梯形DAC；
 
（3）迭代結(jié)構(gòu)，包括分區(qū)ADC、流水線型ADC、逐次逼近型ADC；
 
（4）Σ-△結(jié)構(gòu)，包括Σ-△ADC和DAC。
 
下面以ADC為例對(duì)以上幾種結(jié)構(gòu)進(jìn)行介紹。
 
1．并行結(jié)構(gòu)
 
并行結(jié)構(gòu)的數(shù)據(jù)轉(zhuǎn)換器的基本思想是：同時(shí)比較待轉(zhuǎn)換的信號(hào)電平與所有級(jí)別的量化電平之間的關(guān)系，在模擬信號(hào)和數(shù)字信號(hào)之間相互轉(zhuǎn)換。并行結(jié)構(gòu)所對(duì)應(yīng)的A/D和D/A轉(zhuǎn)換器件分別為Flash-ADC和串狀DAC。
 
Flash-ADC內(nèi)含一列并聯(lián)比較器，一列由電阻分壓器產(chǎn)生的電平作為相應(yīng)的比較器的基準(zhǔn)電壓。被轉(zhuǎn)換的模擬電壓信號(hào)同時(shí)加到全部比較器上，各比較器的輸出經(jīng)編碼后作為ADC的輸出，如圖2.12所示。
 
一個(gè)分辨率為N（bit）的Flash-ADC含有2N個(gè)精密電阻，2N?1個(gè)高速比較器；分辨率每增加1bit，需要增加2N個(gè)精密電阻和2N個(gè)高速比較器，這會(huì)大大增加集成的復(fù)雜度和器件功耗。因此一般Flash-ADC的分辨率無(wú)法達(dá)到很高。
 
串狀DAC是實(shí)現(xiàn)Flash-ADC的逆操作，因使用電阻串來(lái)構(gòu)造參考電壓而得名，在有的書中也被稱為開(kāi)爾文分配器。串狀DAC依靠待轉(zhuǎn)換數(shù)據(jù)來(lái)控制一組開(kāi)關(guān)，以產(chǎn)生合適的電流通過(guò)精密電阻，從而產(chǎn)生合適的模擬信號(hào)電壓。

3HAC14265-1
DSQC539
3HAC13151-1
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